试题

在一个五段式指令流水线的CPU中，当执行lw指令（从内存中取数据）或sw指令（往内存中写数据）时，TLB缺失和Cache缺失有可能在( )时钟周期被检测到。

①IF（取指）②ID（译码/取数）③EX（执行）

④Mem（存储器访问）⑤WB（写回）

A : ①和②

B : ①和④

C : ②、④和⑤

D : ①、④和⑤

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